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TMS320C5515
SPRS645F – AUGUST 2010 – REVISED OCTOBER 2013
www.ti.com
1.4
Functional Block Diagram
Figure 1-1 shows the functional block diagram of the device.
DSP System
JTAG Interface
C55x? DSP CPU
Input
Clock(s)
PLL/Clock
Generator
Power
Management
Pin
Multiplexing
FFT Hardware
Accelerator
64 KB DARAM
256 KB SARAM
128 KB ROM
Switched Central Resource (SCR)
Peripherals
Interconnect
Serial Interfaces
Program/Data Storage
I S
I C
DMA
(x4)
2
(x4)
2
SPI
UART
NAND, NOR,
SRAM, mSDRAM
MMC/SD
(x2)
App-Spec
Display
Connectivity
System
10-Bit
SAR
ADC
LCD
Bridge
USB 2.0
PHY (HS)
[DEVICE]
RTC
GP Timer
(x2)
GP Timer
or WD
LDOs
Figure 1-1. Functional Block Diagram
4
Fixed-Point Digital Signal Processor
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